디지털 디자인 - 4비트 parity generator, 5비트 parity checker

디지털 디자인 - 4비트 parity generator, 5비트 parity checker

1.even parity 4bit generator
입력 4비트 뒤에 parity bit를 붙여 1의 개수를 even으로 만든다.

(1) 진리표

(2)Boolean funtion
P=w⊕x⊕y⊕z

(3)karno map

(4)schematic diagram

(5)verilog HDL code

(6)compile log analysis

회로에 대해 간략한 합성결과를 알수있다.

Compilation Report를 통해 설계한 회로에 대한 정보를 볼 수 있다.

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[hwp/pdf]디지털 디자인 - 4비트 parity generator, 5비트 parity checker